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<!-- Product Version: Vivado v2020.2 (64-bit) -->
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<!-- Copyright 1986-2020 Xilinx, Inc. All Rights Reserved. -->
<Project Version="7" Minor="54" Path="E:/Documents/Code/CPE 233/CPE233Labs/CPE233Labs.xpr">
<DefaultLaunch Dir="$PRUNDIR"/>
<Configuration>
<Option Name="Id" Val="a8d623e77cb64af19a5c830bfb458e68"/>
<Option Name="Part" Val="xc7a35tcpg236-1"/>
<Option Name="CompiledLibDir" Val="$PCACHEDIR/compile_simlib"/>
<Option Name="CompiledLibDirXSim" Val=""/>
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<Option Name="CompiledLibDirIES" Val="$PCACHEDIR/compile_simlib/ies"/>
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<Option Name="CompiledLibDirRiviera" Val="$PCACHEDIR/compile_simlib/riviera"/>
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<Option Name="WTActivehdlExportSim" Val="0"/>
<Option Name="GenerateIPUpgradeLog" Val="TRUE"/>
<Option Name="XSimRadix" Val="hex"/>
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<Option Name="SimTypes" Val="tlm_dpi"/>
<Option Name="MEMEnableMemoryMapGeneration" Val="TRUE"/>
<Option Name="DcpsUptoDate" Val="TRUE"/>
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<FileSets Version="1" Minor="31">
<FileSet Name="sources_1" Type="DesignSrcs" RelSrcDir="$PSRCDIR/sources_1" RelGenDir="$PGENDIR/sources_1">
<Filter Type="Srcs"/>
<File Path="$PSRCDIR/sources_1/new/mux_2t1_nb.v">
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</File>
<File Path="$PSRCDIR/sources_1/new/mux_4t1_nb.v">
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</File>
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<File Path="$PSRCDIR/sources_1/new/rca_nb.v">
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<File Path="$PSRCDIR/sources_1/new/reg_nb_sclr.v">
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<File Path="$PSRCDIR/sources_1/new/ALU.sv">
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<File Path="$PSRCDIR/sources_1/new/CSR.v">
<FileInfo SFType="SVerilog">
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<File Path="$PSRCDIR/sources_1/new/Exp4.sv">
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<File Path="$PSRCDIR/sources_1/new/OTTER_MCU.sv">
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<File Path="$PSRCDIR/sources_1/imports/Downloads/control_unit_dcdr_v_1_04.sv">
<FileInfo>
<Attr Name="ImportPath" Val="$PPRDIR/../../Downloads/control_unit_dcdr_v_1_04.sv"/>
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<File Path="$PSRCDIR/sources_1/imports/Downloads/control_unit_fsm_v_1_06.sv">
<FileInfo>
<Attr Name="ImportPath" Val="$PPRDIR/../../Downloads/control_unit_fsm_v_1_06.sv"/>
<Attr Name="ImportTime" Val="1619900741"/>
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<File Path="$PSRCDIR/sources_1/imports/Downloads/reg_file_v_1_01.sv">
<FileInfo>
<Attr Name="ImportPath" Val="$PPRDIR/../../Downloads/reg_file_v_1_01.sv"/>
<Attr Name="ImportTime" Val="1619900758"/>
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<File Path="$PSRCDIR/sources_1/new/timer_counter.sv">
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<File Path="$PSRCDIR/sources_1/imports/Downloads/OTTER_Wrapper_v1_07.sv">
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<Attr Name="ImportPath" Val="$PPRDIR/../../Downloads/OTTER_Wrapper_v1_07.sv"/>
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<File Path="$PSRCDIR/sources_1/new/DBounce.sv">
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</File>
<File Path="$PSRCDIR/sources_1/new/one_shot_bdir.sv">
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</File>
<File Path="$PSRCDIR/sources_1/new/clk_2n_div_test.v">
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</File>
<File Path="$PSRCDIR/sources_1/new/univ_sseg.v">
<FileInfo>
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</File>
<File Path="$PSRCDIR/sources_1/new/comp_nb.v">
<FileInfo>
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</File>
<File Path="$PSRCDIR/sources_1/new/clk_divider_nbit.v">
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</File>
<File Path="$PSRCDIR/sources_1/new/cntr_up4_clr_nb.v">
<FileInfo>
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</File>
<File Path="$PSRCDIR/sources_1/new/ram_single_port.v">
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</File>
<File Path="$PSRCDIR/sources_1/new/reg_nb.v">
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</FileInfo>
</File>
<File Path="$PSRCDIR/sources_1/new/Exp1.sv">
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</File>
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<FileInfo>
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</File>
<File Path="$PSRCDIR/sources_1/new/PC_MOD.sv">
<FileInfo>
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</FileInfo>
</File>
<File Path="$PSRCDIR/sources_1/new/fib_fsm.sv">
<FileInfo>
<Attr Name="AutoDisabled" Val="1"/>
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</File>
<File Path="$PSRCDIR/sources_1/new/otter_memory.mem">
<FileInfo>
<Attr Name="UsedIn" Val="synthesis"/>
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</FileInfo>
</File>
<File Path="$PSRCDIR/sources_1/imports/Downloads/cntr_up_clr_nb_v1_03.v">
<FileInfo>
<Attr Name="AutoDisabled" Val="1"/>
<Attr Name="ImportPath" Val="$PPRDIR/../../Downloads/cntr_up_clr_nb_v1_03.v"/>
<Attr Name="ImportTime" Val="1617217410"/>
<Attr Name="UsedIn" Val="synthesis"/>
<Attr Name="UsedIn" Val="implementation"/>
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</File>
<File Path="$PSRCDIR/sources_1/new/exp5_testbench.v">
<FileInfo>
<Attr Name="AutoDisabled" Val="1"/>
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</File>
<Config>
<Option Name="DesignMode" Val="RTL"/>
<Option Name="TopModule" Val="OTTER_Wrapper"/>
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</FileSet>
<FileSet Name="constrs_1" Type="Constrs" RelSrcDir="$PSRCDIR/constrs_1" RelGenDir="$PGENDIR/constrs_1">
<Filter Type="Constrs"/>
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<Attr Name="UsedIn" Val="synthesis"/>
<Attr Name="UsedIn" Val="implementation"/>
</FileInfo>
</File>
<Config>
<Option Name="ConstrsType" Val="XDC"/>
</Config>
</FileSet>
<FileSet Name="sim_1" Type="SimulationSrcs" RelSrcDir="$PSRCDIR/sim_1" RelGenDir="$PGENDIR/sim_1">
<Filter Type="Srcs"/>
<File Path="$PSRCDIR/sim_1/new/Exp4Sim.v">
<FileInfo>
<Attr Name="AutoDisabled" Val="1"/>
<Attr Name="UsedIn" Val="synthesis"/>
<Attr Name="UsedIn" Val="implementation"/>
<Attr Name="UsedIn" Val="simulation"/>
</FileInfo>
</File>
<File Path="$PSRCDIR/sim_1/new/tb.v">
<FileInfo>
<Attr Name="AutoDisabled" Val="1"/>
<Attr Name="UsedIn" Val="synthesis"/>
<Attr Name="UsedIn" Val="implementation"/>
<Attr Name="UsedIn" Val="simulation"/>
</FileInfo>
</File>
<File Path="$PSRCDIR/sim_1/new/exp_1_sim.sv">
<FileInfo>
<Attr Name="AutoDisabled" Val="1"/>
<Attr Name="UsedIn" Val="synthesis"/>
<Attr Name="UsedIn" Val="implementation"/>
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</File>
<File Path="$PPRDIR/otter_tb_behav.wcfg">
<FileInfo>
<Attr Name="UsedIn" Val="simulation"/>
</FileInfo>
</File>
<Config>
<Option Name="DesignMode" Val="RTL"/>
<Option Name="TopModule" Val="otter_tb"/>
<Option Name="TopLib" Val="xil_defaultlib"/>
<Option Name="TransportPathDelay" Val="0"/>
<Option Name="TransportIntDelay" Val="0"/>
<Option Name="SelectedSimModel" Val="rtl"/>
<Option Name="PamDesignTestbench" Val=""/>
<Option Name="PamDutBypassFile" Val="xil_dut_bypass"/>
<Option Name="PamSignalDriverFile" Val="xil_bypass_driver"/>
<Option Name="PamPseudoTop" Val="pseudo_tb"/>
<Option Name="SrcSet" Val="sources_1"/>
<Option Name="XSimWcfgFile" Val="$PPRDIR/otter_tb_behav.wcfg"/>
</Config>
</FileSet>
<FileSet Name="utils_1" Type="Utils" RelSrcDir="$PSRCDIR/utils_1" RelGenDir="$PGENDIR/utils_1">
<Filter Type="Utils"/>
<Config>
<Option Name="TopAutoSet" Val="TRUE"/>
</Config>
</FileSet>
</FileSets>
<Simulators>
<Simulator Name="XSim">
<Option Name="Description" Val="Vivado Simulator"/>
<Option Name="CompiledLib" Val="0"/>
</Simulator>
<Simulator Name="ModelSim">
<Option Name="Description" Val="ModelSim Simulator"/>
</Simulator>
<Simulator Name="Questa">
<Option Name="Description" Val="Questa Advanced Simulator"/>
</Simulator>
<Simulator Name="Riviera">
<Option Name="Description" Val="Riviera-PRO Simulator"/>
</Simulator>
<Simulator Name="ActiveHDL">
<Option Name="Description" Val="Active-HDL Simulator"/>
</Simulator>
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<Run Id="synth_1" Type="Ft3:Synth" SrcSet="sources_1" Part="xc7a35tcpg236-1" ConstrsSet="constrs_1" Description="Vivado Synthesis Defaults" AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" State="current" Dir="$PRUNDIR/synth_1" IncludeInArchive="true" AutoIncrementalDir="$PSRCDIR/utils_1/imports/synth_1">
<Strategy Version="1" Minor="2">
<StratHandle Name="Vivado Synthesis Defaults" Flow="Vivado Synthesis 2020"/>
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<Report Name="ROUTE_DESIGN.REPORT_METHODOLOGY" Enabled="1"/>
<RQSFiles/>
</Run>
<Run Id="impl_1" Type="Ft2:EntireDesign" Part="xc7a35tcpg236-1" ConstrsSet="constrs_1" Description="Default settings for Implementation." AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" State="current" Dir="$PRUNDIR/impl_1" SynthRun="synth_1" IncludeInArchive="true" GenFullBitstream="true" AutoIncrementalDir="$PSRCDIR/utils_1/imports/impl_1">
<Strategy Version="1" Minor="2">
<StratHandle Name="Vivado Implementation Defaults" Flow="Vivado Implementation 2020"/>
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</Strategy>
<GeneratedRun Dir="$PRUNDIR" File="gen_run.xml"/>
<ReportStrategy Name="Vivado Implementation Default Reports" Flow="Vivado Implementation 2020"/>
<Report Name="ROUTE_DESIGN.REPORT_METHODOLOGY" Enabled="1"/>
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